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單項(xiàng)選擇題

使用Quartus Ⅱ的圖形編輯方式輸入的電路原理圖文件必須通過(guò)（）才能進(jìn)行仿真驗(yàn)證。

A.編輯
B.編譯
C.綜合
D.編程

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單項(xiàng)選擇題

VHDL的設(shè)計(jì)實(shí)體可以被高層次的系統(tǒng)（），成為系統(tǒng)的一部分。

A.輸入
B.輸出
C.仿真
D.調(diào)用

單項(xiàng)選擇題

在VHDL的進(jìn)程語(yǔ)句格式中，敏感信號(hào)表列出的應(yīng)當(dāng)是設(shè)計(jì)電路的（）信號(hào)。

A.輸入
B.輸入和輸出
C.輸出
D.時(shí)鐘

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