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單項選擇題
VHDL的設(shè)計實體可以被高層次的系統(tǒng)(),成為系統(tǒng)的一部分。
A.輸入
B.輸出
C.仿真
D.調(diào)用
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單項選擇題
在VHDL的進(jìn)程語句格式中,敏感信號表列出的應(yīng)當(dāng)是設(shè)計電路的()信號。
A.輸入
B.輸入和輸出
C.輸出
D.時鐘
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單項選擇題
在VHDL中,為了使已聲明的數(shù)據(jù)類型、子程序、元件能被其他設(shè)計實體調(diào)用或共享,可以把它們匯集在()中。
A.設(shè)計實體
B.程序庫
C.結(jié)構(gòu)體
D.程序包
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