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單項(xiàng)選擇題

下列代碼“input clk /*synthesis chip_pin=“G21””含義為（）。

A.定義變量clk
B.設(shè)置時(shí)鐘變量
C.將時(shí)鐘信號的引腳鎖定到G21
D.同步clk引腳到G21

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單項(xiàng)選擇題

錯(cuò)誤提示：Error （12007）：Top-level design entity "CNT4b"is undefined可能是以下哪種錯(cuò)誤？（）

A.變量類型定義錯(cuò)誤
B.變量CNT4b未定義
C.未設(shè)置頂層實(shí)體
D.頂層實(shí)體模塊未定義

單項(xiàng)選擇題

從代碼always@（posedge CLK or negedge RST）可以看出（）。

A.RST是同步信號，高電平有效
B.RST是異步信號，低電平有效
C.RST是同步信號，下降沿有效
D.RST是異步信號，下降沿電平有效

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