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單項(xiàng)選擇題

當(dāng)w

A.原圖G中w< J的邊在J階展開GJ中生成J-w條無(wú)延遲的邊和w條延遲為1的邊
B.原圖G中w< J的邊在J階展開GJ中生成J-w條延遲為1的邊和w條無(wú)延遲的邊
C.原圖G中w< J的邊在J階展開GJ中生成J條延遲為1的邊
D.原圖G中w< J的邊在J階展開GJ中生成J條無(wú)延遲的邊

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單項(xiàng)選擇題

假設(shè)加法器延時(shí)為1u.t.，乘法器延時(shí)為2u.t.，如圖所示電路的迭代邊界為（）。

A.7
B.9/2
C.7/3
D.5

單項(xiàng)選擇題

假設(shè)加法器延時(shí)為1u.t.，乘法器延時(shí)為2u.t.，如圖所示電路的關(guān)鍵路徑的延時(shí)為（）。

A.8
B.7
C.6
D.5

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當(dāng)w

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假設(shè)加法器延時(shí)為1u.t.，乘法器延時(shí)為2u.t.，如圖所示電路的迭代邊界為（）。

假設(shè)加法器延時(shí)為1u.t.，乘法器延時(shí)為2u.t.，如圖所示電路的關(guān)鍵路徑的延時(shí)為（）。

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假設(shè)加法器延時(shí)為1u.t.，乘法器延時(shí)為2u.t.，如圖所示電路的迭代邊界為（）。

假設(shè)加法器延時(shí)為1u.t.，乘法器延時(shí)為2u.t.，如圖所示電路的關(guān)鍵路徑的延時(shí)為（）。