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大規(guī)?？删幊唐骷饕蠪PGA、CPLD兩類，下列對(duì)CPLD結(jié)構(gòu)與工作原理的描述中，正確的是（）。

A.CPLD是基于查找表結(jié)構(gòu)的可編程邏輯器件
B.CPLD即是現(xiàn)場(chǎng)可編程邏輯器件的英文簡(jiǎn)稱
C.早期的CPLD是從FPGA的結(jié)構(gòu)擴(kuò)展而來
D.在Xilinx公司生產(chǎn)的器件中，XC9500系列屬CPLD結(jié)構(gòu)

單項(xiàng)選擇題

IP核在EDA技術(shù)和開發(fā)中占有很重要的地位，提供VHD、L硬件描述語言功能塊，但不涉及實(shí)現(xiàn)該功能模塊的具體電路的IP核為（）。

A、硬件IP
B、固件IP
C、軟件IP
D、都不是

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基于VHDL設(shè)計(jì)的仿真包括有①門級(jí)時(shí)序仿真、②行為仿真、③功能仿真和④前端功能仿真這四種，按照自頂向下的設(shè)計(jì)流程，其先后順序應(yīng)該是（）。

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大規(guī)?？删幊唐骷饕蠪PGA、CPLD兩類，下列對(duì)CPLD結(jié)構(gòu)與工作原理的描述中，正確的是（）。

IP核在EDA技術(shù)和開發(fā)中占有很重要的地位，提供VHD、L硬件描述語言功能塊，但不涉及實(shí)現(xiàn)該功能模塊的具體電路的IP核為（）。

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基于VHDL設(shè)計(jì)的仿真包括有①門級(jí)時(shí)序仿真、②行為仿真、③功能仿真和④前端功能仿真這四種，按照自頂向下的設(shè)計(jì)流程，其先后順序應(yīng)該是（）。

大規(guī)?？删幊唐骷饕蠪PGA、CPLD兩類，下列對(duì)CPLD結(jié)構(gòu)與工作原理的描述中，正確的是（）。

IP核在EDA技術(shù)和開發(fā)中占有很重要的地位，提供VHD、L硬件描述語言功能塊，但不涉及實(shí)現(xiàn)該功能模塊的具體電路的IP核為（）。