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填空題

Verilog HDL的功能描述可以用（）、（）、（）和（）等方法來(lái)實(shí)現(xiàn)，通常把確定這些設(shè)計(jì)模塊描述的方法稱為建模。

答案： assign語(yǔ)句；元件例化（instantiate）；always塊語(yǔ)句；initial塊語(yǔ)句

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Verilog HDL的功能描述是用來(lái)描述設(shè)計(jì)模塊的（）和模塊端口間的（）。

答案：內(nèi)部結(jié)構(gòu)；邏輯關(guān)系

Verilog HDL的模塊Verilog HDL模塊的T/O聲明用來(lái)聲明模塊端口定義中各端口數(shù)據(jù)流動(dòng)方向，包括（）、（）和（）。

答案：輸入（input）；輸出（output）；雙向（inout）

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